猪狩/2008-07-17
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開始行:
[[猪狩]]
//研究室限定
*7/17(木) 2008 [#ee8858b6]
SCCPの事すっかり忘れてました↓↓
-研究
--verilog HDLとVHDLは混在出来る!!
---ISE6.1のXSTから可能になったみたい
---バスマクロがVHDLで書かれてあるから、その解読が必要
--DCMの構造がよくわからん
-院試の準備
--志望動機と研究計画は覚える!!(まだ途中)
--明日、面接の練習をすることになった
終了行:
[[猪狩]]
//研究室限定
*7/17(木) 2008 [#ee8858b6]
SCCPの事すっかり忘れてました↓↓
-研究
--verilog HDLとVHDLは混在出来る!!
---ISE6.1のXSTから可能になったみたい
---バスマクロがVHDLで書かれてあるから、その解読が必要
--DCMの構造がよくわからん
-院試の準備
--志望動機と研究計画は覚える!!(まだ途中)
--明日、面接の練習をすることになった
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