春のプロジェクト2010/第5回
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開始行:
[[春のプロジェクト2010]]
*第5回 ステートマシンの設計 [#r54bbbe6]
** 概要 [#hf607ac3]
+CPUの基本動作
+ステートマシンの設計と記述
+シミュレーション
**Keyword [#a4be85d6]
-命令フェッチ、命令実行、状態遷移図、動作開始、待機状態、動作終了
***CPUの基本動作 [#jae202bf]
-基本的なCPUの動作は?
-状態遷移図とは?
-ステートマシンとは?
***ステートマシンの設計 [#c0592627]
-状態はいくつか?
-現在の状態から次の状態に行く条件や動作を確認する
-入力は?
-出力は?
***ステートマシンのverilog記述 [#u8de5252]
-状態を保持するレジスタは何ビット必要か?
-記述方法を知る
--define
--case
***シミュレーション [#x1ca9f19]
-テストベンチを作る
--先に期待する出力結果を考える
-シミュレーションする
----
#comment
終了行:
[[春のプロジェクト2010]]
*第5回 ステートマシンの設計 [#r54bbbe6]
** 概要 [#hf607ac3]
+CPUの基本動作
+ステートマシンの設計と記述
+シミュレーション
**Keyword [#a4be85d6]
-命令フェッチ、命令実行、状態遷移図、動作開始、待機状態、動作終了
***CPUの基本動作 [#jae202bf]
-基本的なCPUの動作は?
-状態遷移図とは?
-ステートマシンとは?
***ステートマシンの設計 [#c0592627]
-状態はいくつか?
-現在の状態から次の状態に行く条件や動作を確認する
-入力は?
-出力は?
***ステートマシンのverilog記述 [#u8de5252]
-状態を保持するレジスタは何ビット必要か?
-記述方法を知る
--define
--case
***シミュレーション [#x1ca9f19]
-テストベンチを作る
--先に期待する出力結果を考える
-シミュレーションする
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