三浦/日誌/2009-12-10
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開始行:
[[三浦/日誌]]
-NoC
--前日の問題:先頭フリットがFIFOにストアされない。
--テストベンチ上にて、clkとrstを同期させると問題が発生。
--rstの変更のタイミングをずらすと解決。
--シミュレータの問題か?(NC-Verilog使用)
--万が一でもFPGAでclkとrstが同期してしまったらフリットが消失してしまう。
--要解決。
----
- OASIS自体がゲートレベルのシミュレーションができない?FPGAに載らない可能性大。やはりaltera推奨の記述に直す必要があるか。 -- &new{2009-12-10 (木) 15:38:19};
- 親友の就職が決まったようだ。嬉しいものだ。研究が進めばもっと嬉しい。 -- &new{2009-12-11 (金) 00:09:06};
#comment
終了行:
[[三浦/日誌]]
-NoC
--前日の問題:先頭フリットがFIFOにストアされない。
--テストベンチ上にて、clkとrstを同期させると問題が発生。
--rstの変更のタイミングをずらすと解決。
--シミュレータの問題か?(NC-Verilog使用)
--万が一でもFPGAでclkとrstが同期してしまったらフリットが消失してしまう。
--要解決。
----
- OASIS自体がゲートレベルのシミュレーションができない?FPGAに載らない可能性大。やはりaltera推奨の記述に直す必要があるか。 -- &new{2009-12-10 (木) 15:38:19};
- 親友の就職が決まったようだ。嬉しいものだ。研究が進めばもっと嬉しい。 -- &new{2009-12-11 (金) 00:09:06};
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