原口/春プロ/第3回
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開始行:
[[原口/春プロ]]
*第3回 マルチプレクサと算術演算回路 [#s53bfe5b]
**case文(例) [#a3b57fff]
always @(a or b or c or f)
case(f)
2'b00: s=a;
2'b01: s=b;
2'b10: s=c;
default: s=1'bx;
endcase
-引数の値によってい動作が変化する。C言語のswitch文と良く似た機能
-default文
--必ず書く、省略不可
--上のプログラムでは省略するとfの値が"11"の時sの値は変更されず「現在の値を保持」することになり、非同期ラッチを生成してしまうことになる。(つまり違う機能の回路になってしまう)
**算術演算回路aluの仕様 [#nb5540f1]
-P131の表1を参照
**Verilog HDLの主な演算子 [#wb50409e]
-P131の表2を参照
終了行:
[[原口/春プロ]]
*第3回 マルチプレクサと算術演算回路 [#s53bfe5b]
**case文(例) [#a3b57fff]
always @(a or b or c or f)
case(f)
2'b00: s=a;
2'b01: s=b;
2'b10: s=c;
default: s=1'bx;
endcase
-引数の値によってい動作が変化する。C言語のswitch文と良く似た機能
-default文
--必ず書く、省略不可
--上のプログラムでは省略するとfの値が"11"の時sの値は変更されず「現在の値を保持」することになり、非同期ラッチを生成してしまうことになる。(つまり違う機能の回路になってしまう)
**算術演算回路aluの仕様 [#nb5540f1]
-P131の表1を参照
**Verilog HDLの主な演算子 [#wb50409e]
-P131の表2を参照
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