加藤/日誌/2010-11-17
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開始行:
-研究
--中間発表で指摘された箇所の仕様を変更した
--論理検証の結果
---PCは更新されていないが、毎回、ストップしている命令は実行されるため書き込みデータが更新されている
---QREGから値がStoreされているため値が更新されている
--Storeする値のレジスタなどに待避させたほうがいいのか?
--Clockをストップさせたほうがいいのか?
--どうなんでしょう?
-実機検証
--前の仕様は改善したはずなのに.......以前と同じ結果になった!!
--なんで????
--意味が分からないので
--帰ります
~
-----------------
- http://www.altera.co.jp/literature/an/an311_j.pdf -- [[前田]] &new{2010-11-17 (水) 16:05:00};
- p13以降参照。ASICではなく、FPGAを使う理由が動作検証のみであればクロックイネーブルピンによるデザインを採用するとか。実際にFPGA上では消費電力を抑えることはできないし、定量的な評価はとれないけど。 -- [[前田]] &new{2010-11-17 (水) 16:06:31};
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終了行:
-研究
--中間発表で指摘された箇所の仕様を変更した
--論理検証の結果
---PCは更新されていないが、毎回、ストップしている命令は実行されるため書き込みデータが更新されている
---QREGから値がStoreされているため値が更新されている
--Storeする値のレジスタなどに待避させたほうがいいのか?
--Clockをストップさせたほうがいいのか?
--どうなんでしょう?
-実機検証
--前の仕様は改善したはずなのに.......以前と同じ結果になった!!
--なんで????
--意味が分からないので
--帰ります
~
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- http://www.altera.co.jp/literature/an/an311_j.pdf -- [[前田]] &new{2010-11-17 (水) 16:05:00};
- p13以降参照。ASICではなく、FPGAを使う理由が動作検証のみであればクロックイネーブルピンによるデザインを採用するとか。実際にFPGA上では消費電力を抑えることはできないし、定量的な評価はとれないけど。 -- [[前田]] &new{2010-11-17 (水) 16:06:31};
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